DK-DEV-5SGXEA7N【PDF 306/527 页】KIT DEV STRATIX V FPGA 5SGXEA7

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1-6

Channel Variants

SV52002

2014.01.07

Figure 1-6: General Transceiver Bank Locations for GS Devices

Ch 5

Ch 4

IOBANK_B3L

6 Ch

PCIe

PCIe

6 Ch

IOBANK_B3R

Ch 3

Ch 2

Hard

Hard

Ch 1

IOBANK_B2L

IOBANK_B1L

6 Ch

6 Ch

IP

PCIe

Hard

IP

PCIe

6 Ch

6 Ch

IOBANK_B2R

IOBANK_B1R

Ch 0

IP

with

Hard

IP

IOBANK_B0L

6 Ch

CvP

6 Ch

IOBANK_B0R

Transceiver

Bank Names

Number of Channels

Per Bank

Channel Variants

GS/GX Devices

Transceiver

Bank Names

Number of Channels

Per Bank

?

?

?

?

?

12-channel devices use banks B0L and B1L

24-channel devices use banks B0L, B1L, B0R and B1R

36-channel devices use banks B0L, B1L, B2L, B0R, B1R, and B2R

48-channel devices use banks B0L, B1L, B2L, B3L, B0R, B1R, B2R, and B3R

66-channel devices use all banks (GX only)

GT Devices

These 36-channel devices use banks B0L, B1L, B2L, B3L, B0R, B1R, B2R, and B3R.

GS/GT/GX Device Variants and Packages

Table 1-2: Stratix V GS, GT, and GX Device Variant Packages

Device Variant

PCIe HIP Blocks

# of Transceivers

Package

Side of Device with

Transceivers

5SGSD3

1

1

12

24

EH29

HF35

Left

Left and Right

Altera Corporation

Transceiver Architecture in Stratix V Devices

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